應(yīng)屆畢業(yè)生
學(xué)歷不限
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職位描述
該職位還未進(jìn)行加V認(rèn)證，請仔細(xì)了解后再進(jìn)行投遞！
崗位職責(zé)：
- 參與數(shù)字IC驗(yàn)證流程
- 負(fù)責(zé)使用Verilog或System Verilog進(jìn)行硬件描述和驗(yàn)證
崗位要求：
1. 2025年應(yīng)屆生，二本以上，電子信息，集成電路相關(guān)專業(yè)
2. 熟悉Verilog或System Verilog，熟悉腳本語言：C或Python
3. 在校期間參與過數(shù)字IC或FPGA的科研項(xiàng)目或競賽，或者有相關(guān)實(shí)習(xí)經(jīng)驗(yàn)
4. 熟悉數(shù)字IC設(shè)計(jì)研發(fā)或驗(yàn)證流程
注：聯(lián)系我時(shí)，請說是在云南人才網(wǎng)上看到的。
工作地點(diǎn)
地址：瀘州龍馬潭區(qū)瀘州龍馬潭區(qū)科維商城1
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職位發(fā)布者
周國沛/..HR
成都信必優(yōu)信息技術(shù)有限公司
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公司性質(zhì)未知
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